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반도체 패키징 혁명: CoWoS에서 SoIC까지

후공정이 전공정보다 중요해지는 시대

해해랑달·Founder Analyst2026년 2월 24일읽기 7분패키징, CoWoS, HBM, OSAT, 2.5D

Reader's Brief — 30초 요약

고급
한 줄 결론

AI 시대의 반도체 성능 경쟁은 트랜지스터 미세화가 아닌 패키징 집적도 경쟁으로 판이 바뀌었으며, 후공정이 반도체 밸류체인의 새 핵심이 됐다.

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왜 지금

TSMC CoWoS 수요가 공급을 2~3배 초과하면서 NVIDIA B100/B200 출하 병목의 진짜 원인이 패키징임이 드러났고, 인텔 EMIB·삼성 I-Cube·TSMC SoIC 경쟁이 본격화됐다.

수혜·피해

수혜 가능성이 큰 카테고리 — TSMC(CoWoS 독점적 지위), ASE·암코(OSAT), 기판(ABF 기판 업체). 압박 — 전통 DRAM/NAND 패키징 위주의 범용 OSAT, 2.5D/3D 투자 여력이 부족한 중소 패키징 업체.

모니터링

분기마다 TSMC의 CoWoS 용량 증설 발표와 AI 가속기 업체들의 신규 패키징 파트너십 체결을 추적할 것.

핵심 용어 (6)펼치기 ↓접기 ↑
CoWoS
Chip on Wafer on Substrate. TSMC의 2.5D 어드밴스드 패키징. HBM과 GPU 다이를 인터포저로 연결해 초고속 데이터 전송 구현.
SoIC
System on Integrated Chips. TSMC의 3D 패키징 기술로 칩을 수직 적층. 다이 간 거리를 최소화해 AI 연산 병목 해소.
OSAT
Outsourced Semiconductor Assembly and Test. 반도체 후공정(패키징·테스트)을 전문으로 하는 외주 업체. ASE·암코·SPIL이 대표적.
인터포저
칩 다이들을 연결하는 중간 기판. 실리콘 인터포저는 데이터 전송 속도를 높이고 전력을 낮추는 핵심 구조물.
EMIB
Embedded Multi-Die Interconnect Bridge. 인텔의 2.5D 패키징 기술. 실리콘 인터포저 대신 소형 브리지 칩을 매입해 비용 절감.
2.5D / 3D 패키징
칩을 평면(2.5D) 또는 수직(3D)으로 집적하는 어드밴스드 패키징 기술. 공정 미세화의 물리적 한계를 패키징으로 극복.

핵심 요약

반도체 산업의 무게 중심이 '전공정(Fab)'에서 '후공정(패키징)'으로 이동하고 있습니다. 이것은 일시적 트렌드가 아니라 무어의 법칙 한계가 만든 구조적 전환입니다.

왜 패키징이 중요한가?

  • 트랜지스터 미세화는 3nm → 2nm에서 물리적 한계에 근접
  • 성능 향상의 열쇠가 '더 작은 트랜지스터'에서 '더 넓은 인터커넥트'로 전환
  • NVIDIA B200 GPU: 다이 자체보다 CoWoS 패키징이 원가의 40%+ 차지
  • HBM4: 12단 이상 스태킹으로 패키징 기술이 성능·수율을 결정
핵심 지표수치
패키징 시장 규모 (2025)$45B
패키징 시장 규모 (2028E)$75B (CAGR 18%)
선단 패키징 비중 (2025 → 2028)25% → 45%
NVIDIA B200 원가 중 패키징 비중40%+

패키징 시장 규모:

  • 2025년: $45B → 2028년: $75B (CAGR 18%)
  • 선단 패키징(2.5D/3D) 비중: 2025년 25% → 2028년 45%

투자 기회 3축: 1. TSMC CoWoS: 2.5D 패키징의 절대 강자, 캐파 부족이 곧 투자 기회 2. 한미반도체 TC 본더: HBM 스태킹 핵심 장비, 독점적 지위 3. Amkor Technology: 글로벌 OSAT 2위, 선단 패키징 투자 가속

이 보고서에서는 패키징 기술의 진화, CoWoS·HBM 패키징의 현황, 핵심 장비·소재 기업, 그리고 투자 전략을 분석합니다.

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